پردازش سیگنال در تراشه‌های Versal با بلوک‌های DSP58
پشتیبانی از چندین مد عملکردی جدید باعث استفاده موثر از بلوک‌های DSP58 در الگوریتم‌های پردازش ویدئو، سیستم‌های بی سیم و اپلیکیشن‌های شبکه سازی شده است.
Vivado
نُه باور نادرست در مورد سنتز سطح بالا
سنتز سطح بالا را می‌توان به عنوان یک ابزار کارآمد با بهره وری قابل قبول برای طراحی سخت افزار در نظر گرفت، هر چند چندین حقیقت ناگفته پیرامون این مفهوم وجود دارد.
بلوک‌های UltraRAM در تراشه‌های +UltraScale
بلوک‌های UltraRAM در تراشه‌های +UltraScale جایگزین حافظه‌های خارجی هستند و کارایی و عملکرد بسیار بهتری را نسبت به آن‌ها به همراه می‌آورند.
لچ و چگونگی شکل گیری آن در کدهای HDL
درک عملکرد لچ و چگونگی شکل گیری آن باعث بهبود پایداری طرح می‌شود. معمولاً استفاده از لچ به جای فلیپ فلاپ مزیتی به همراه ندارد.
فراخوانی حافظه‌ها و عناصر سنکرون ساز کلاک با استفاده از XPM
حافظه‌ها و عناصر سنکرون ساز کلاک از جمله ساختارهایی هستند که معمولاً در تمامی طراحی‌های FPGA مورد استفاده قرار می‌گیرند.
بلوک‌های DSP48 : قلب تپنده پردازش سیگنال
اپلیکیشن‌های پردازش سیگنال به تعداد زیادی ضرب و جمع نیاز دارند که بهترین گزینه برای پیاده سازی آن‌ها استفاده از DSP48 Slice های اختصاصی درون تراشه‌های FPGA است.
پیاده سازی فیلتر FIR در Vivado
با دروازه ورود به دنیای پردازش سیگنال در FPGA از طریق فراگیری الفبای پیاده سازی فیلتر FIR در Vivado تنها چند قدم فاصله دارید.
اینترفیس AXI (قسمت سوم: شبیه سازی AXI4-Lite با AXI VIP)
در قسمت سوم این سری آموزشی قصد داریم با اضافه کردن AXI VIP به یک پروژه در Vivado فرایند شبیه سازی اینترفیس AXI4-Lite با AXI VIP را به طور کامل بررسی کنیم.
قست سوم: پکیج کردن HLS IP برای Vivado IP Catalog
در این ویدئو شیوه پکیج کردن HLS IP برای Vivado IP Catalog را باهم مرور خواهیم کرد. این HLS IP می‌تواند در محیط Vivado IP Integrator فراخوانی و استفاده شود.