تبدیل فوریه در FPGA با Xilinx FFT IP Core
الگوریتم FFT به کلاسی از الگوریتم‌های پردازش سیگنال اطلاق می‌شود که می‌توانند به شکل بهینه تبدیل فوریه گسسته (DFT) یک دنباله را محاسبه کند.
تبدیل فوریه در FPGA با Xilinx FFT IP Core ادامه مطلب »
ابزارهای طراحی
محاسبه سینوس و کسینوس در FPGA با استفاده از CORDIC
روش‌‌های متفاوتی برای محاسبه سینوس و کسینوس در FPGA وجود دارد که یکی از آن‌ها استفاده از CORDIC IP Core در مجموعه نرم افزاری ISE و Vivado است.
محاسبه سینوس و کسینوس در FPGA با استفاده از CORDIC ادامه مطلب »
پیاده سازی فیلتر FIR در Vivado
با دروازه ورود به دنیای پردازش سیگنال در FPGA از طریق فراگیری الفبای پیاده سازی فیلتر FIR در Vivado تنها چند قدم فاصله دارید.
پیاده سازی فیلتر FIR در Vivado ادامه مطلب »
طراحی فیلتر FIR با ابزار System Generator for DSP
در پردازش سیگنال فیلترها جایگاه ویژه‌ای دارند، شاید بررسی مسیر پیاده سازی و طراحی یک فیلتر FIR با ابزار System Generator for DSP خالی از لطف نباشد.
طراحی فیلتر FIR با ابزار System Generator for DSP ادامه مطلب »
نکات و تکنیک‌های طراحی با Vivado HLS (بخش اول: پیاده سازی ممیز شناور)
با ظهور HLS کار توسعه الگوریتم‌ها برای تراشه‌های FPGA به شکل کامل متحول شده است، طراحی بهینه نیاز به آشنایی با نکات و تکنیک‌های طراحی در Vivado HLS دارد.
نکات و تکنیک‌های طراحی با Vivado HLS (بخش اول: پیاده سازی ممیز شناور) ادامه مطلب »
قسمت هفتم: تعیین اینترفیس AXI4 برای طرح Vivado HLS
در این ویدئوی کوتاه فرایند تعیین اینترفیس AXI4 برای طرح Vivado HLS را بررسی می‌کنیم و مفاهیم مهمی همچون سنتز اینترفیس و پروتکل‌های ورودی خروجی را معرفی می‌کنیم.
قسمت هفتم: تعیین اینترفیس AXI4 برای طرح Vivado HLS ادامه مطلب »