معماری قابل پیکره‌بندی
بلند شدن و دویدن با مجموعه یکپارچه نرم افزاری Vitis
وقتی که کار با Vitis را آغاز می‌کنیم، اولین چیزی که توجه ما را جلب می‌کند، جایگزین شدن SDSoC ، SDAccel و حتی SDK با مجموعه نرم افزاری Vitis است
تبدیل فوریه در FPGA با Xilinx FFT IP Core
الگوریتم FFT به کلاسی از الگوریتم‌های پردازش سیگنال اطلاق می‌شود که می‌توانند به شکل بهینه تبدیل فوریه گسسته (DFT) یک دنباله را محاسبه کند.
قسمت ششم: آنالیز طرح در Vivado HLS
در این ویدئو به آنالیز و بهینه سازی طرح می‌پردازیم. یکی از بهترین راه‌های یادگیری شیوه آنالیز طرح در Vivado HLS استفاده از مثال‌های کاربردی و مرور قابلیت‌های نمایش Analysis Perspective است.
تکنیک‌های پیاده‌سازی
لچ و چگونگی شکل گیری آن در کدهای HDL
درک عملکرد لچ و چگونگی شکل گیری آن باعث بهبود پایداری طرح می‌شود. معمولاً استفاده از لچ به جای فلیپ فلاپ مزیتی به همراه ندارد.
مبانی محاسبات ریاضی در FPGA (قسمت دوم)
برای پیاده‌سازی محاسبات ریاضی و به طور خاص یک تابع تبدیل ریاضی به صورت ممیز ثابت لازم است، ملاحظات سرریز و رشد بیت روی تراشه‌های FPGA در نظر گرفته شود.
تکنیک‌های سنکرون سازی در FPGA
روش‌ها و تکنیک‌های سنکرون سازی برای مراقبت از دیتا زمانی که از یک محدوده کلاک به محدوده دیگر کلاک در FPGA منتقل می‌شوند، بکار گرفته می‌شوند.
مهارت‌ها
بهبود مهارت‌های طراحی و پیاده‌سازی با هدف بکارگیری آن‌ها در پژوهش‌های دانشگاهی و فعالیت‌های صنعتی
خودآموزی
مهمترین چیزی که ما از شما انتظار داریم، این است که شما می‌توانید هر چیزی را فقط خودتان یاد بگیرید.
آموزش
با بهره‌گیری از خرد جمعی و کارگروهی دست‌یابی به موفقیت برای هر تیمی را امکان‌پذیر می‌کند.